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ISL58328
2
FN6329.2
July 29, 2013
Block Diagram
IV AMP
SLOW TAIL
CONTROL
OUTN
VDD
VREF
0.1礔
GND
0.1礔
+5.0V
OUTP
10k
SERIAL
INTERFACE
SCLK
SDATA
GND
GND
SEN
POWER &
CONTROL
0
1
2
3
4
5
6
7
12
7
0x10-5
1
0
0
0x10-4
x
1
0
BLU
RED
GRN
select
12
12
0
1
2
3
4
5
6
7
0
1
2
3
4
5
6
7
7
7
0
1
2
3
4
5
6
7
TIA GAIN
CONTROL
GAIN
CONTROL
SLOW TAIL
REFERENCE
0
1
2
3
4
5
6
7
+
-
+
-
+
-
+
-
0
1
BLUE GAIN HI (12bits)
Reg 0x12[7:0] +Reg 0x11[7:4]
0
1
BLUE GAIN LO (12bits)
Reg 0x13[7:0] +Reg 0x11[3:0]
0
1
RED GAIN HI (12bits)
Reg 0x15[7:0] +Reg 0x14[7:4]
RED GAIN LO (12bits)
Reg 0x16[7:0] +Reg 0x14[3:0]
GREEN GAIN HI (12bits)
Reg 0x18[7:0] +Reg 0x17[7:4]
GREEN GAIN LO (12bits)
Reg 0x19[7:0] +Reg 0x17[3:0]
0
1
2
h/l
HL
chip_en
tia_h
tia_l
select
LATCH
LATCH
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